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Étudiant en génie électrique
Je vous aiderai à concevoir, déboguer ou simuler des circuits logiques numériques en Verilog ou SystemVerilog, y compris la conception de FSM (machine à états finis) et la rédaction de bancs d'essai. J'utilise Questa et Vivado pour la simulation et la vérification.
Plateforme:
FPGA
Expertise:
Microcontrôleurs