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Je vais développer votre projet FPGA Xilinx avec Vivado et Vitis
Développeur FPGA et IA avec 8 ans d'expérience en Verilog, VHDL, HLS
Je suis ingénieur FPGA & matériel numérique avec plus de 8 ans d’expérience pratique en conception RTL, débogage, vérification, optimisation et accélération hardware.
Je travaille avec Verilog, VHDL,...
Niveau 1
Répond à certains critères de performance et présente un fort potentiel sur la place de marché.
À propos de ce service
Besoin d’aide pour développer un projet FPGA Xilinx avec Vivado ou Vitis ? Je peux vous aider à transformer vos exigences de conception en une implémentation FPGA fonctionnelle.
Je vais développer, intégrer, déboguer et optimiser des projets FPGA AMD Xilinx en utilisant Vivado, Vitis, Verilog, VHDL et SystemVerilog.
Je peux travailler avec :
- Projets Vivado et Block Design
- Zynq et ZynqMP
- Interfaces AXI et IP personnalisés
- Intégration logiciel Vitis
- Développement RTL et intégration IP
- Contraintes XDC
- Simulation et vérification
- Synthèse et implémentation
- Analyse du timing et des ressources
- Génération du bitstream
- Co-conception hardware/software
Je peux travailler sur des projets existants ou développer une solution à partir de vos spécifications.
Mon processus de travail : Exigences -> Conception -> Implémentation -> Simulation -> Synthèse -> Timing -> Vérification
Veuillez m’envoyer votre carte/part FPGA, la version de Vivado/Vitis, les fichiers de projet existants et vos exigences avant de commander.
Pour des projets complexes Zynq, ZynqMP ou hardware personnalisé, veuillez me contacter pour une offre sur mesure.
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FAQ
Traduction automatique
Pouvez-vous travailler sur mon projet Vivado existant ?
Oui. Je peux modifier, déboguer, intégrer, optimiser ou étendre un projet Vivado existant. Veuillez fournir les fichiers du projet et expliquer les modifications nécessaires.
Travaillez-vous avec Zynq et ZynqMP ?
Oui. Je peux travailler sur des systèmes Zynq et ZynqMP, y compris la conception de blocs Vivado, les interfaces AXI, les IP personnalisés, l’intégration hardware/software et Vitis.
Pouvez-vous développer des IP AXI personnalisés ?
Oui. Je peux développer et intégrer des IP RTL personnalisés et les connecter à un système de traitement Zynq/ZynqMP en utilisant les interfaces AXI appropriées.
Pouvez-vous utiliser Vitis ?
Oui. Je peux intégrer la conception matérielle FPGA avec Vitis pour la co-conception hardware/software, y compris la communication entre le processeur et la logique FPGA.
Pouvez-vous travailler avec ma carte FPGA Xilinx spécifique ?
En général, oui. Veuillez fournir le numéro de pièce exact du FPGA/SoC ou le modèle de la carte de développement avant la commande afin que je puisse confirmer la compatibilité.
Pouvez-vous générer le bitstream final ?
Oui. Lorsque les fichiers matériels nécessaires, les contraintes, les IP et les versions des outils sont disponibles, je peux synthétiser, implémenter et générer le bitstream FPGA.
Pouvez-vous corriger les erreurs Vivado ou les problèmes de timing ?
Oui. Je peux examiner les erreurs de synthèse, les erreurs d’implémentation, les violations de timing, les problèmes de contraintes, l’utilisation des ressources et d’autres problèmes de développement FPGA.
Dois-je commander directement ?
Pour des tâches petites et clairement définies, vous pouvez commander le package approprié. Pour des projets complexes FPGA, Zynq/ZynqMP, Vitis ou hardware/software, veuillez me contacter d’abord afin que je puisse examiner les exigences et vous proposer l’offre personnalisée adaptée.
Avis
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A andrewbynoe
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Do a good job . would work with this gig again.
600 $US-800 $US
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