Je construirai votre projet Python de A à Z avec du code orienté objet

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Muhammad Ramish
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À propos de ce service

Traduction automatique

Je réalise des projets Python de A à Z. Vous envoyez votre idée ou vos besoins, et je vous fournis un code fonctionnel, bien structuré, que vous pouvez exécuter et développer.


Ce que je peux réaliser :

- Scripts Python et outils d'automatisation

- Programmes orientés objet (classes, héritage, encapsulation, design patterns)

- Traitement et analyse de données (CSV, Excel, JSON, NumPy, Pandas, Matplotlib)

- Modèles numériques et simulations

- Outils en ligne de commande et petites utilitaires de bureau

- Correction de bugs, refactoring et nettoyage de code


Ma méthode de travail :

1. Vous partagez vos besoins ou votre code existant

2. Je confirme le périmètre, le prix et le délai de livraison

3. Je construis et teste le projet

4. Vous recevez un code propre, commenté, un README et les étapes d'installation


Chaque service comprend :

- Un code lisible, conforme à PEP 8

- Des tests de base pour vérifier son fonctionnement

- Des instructions claires pour l'exécuter

- Des révisions dans le cadre convenu


À propos de moi : plus de 3 ans en tant qu'ingénieur, utilisant Python pour la modélisation, les outils de test et l'automatisation, en parallèle de SystemVerilog et C++.


Veuillez m'envoyer un message avant de commander avec vos besoins afin que je puisse confirmer que je suis la bonne personne et vous donner un devis précis.


Découvrez Muhammad Ramish

Muhammad Ramish

ASIC Digital Design and Verification Engineer

  • DePakistan
  • Membre depuissept. 2026
  • Temps de réponse moy.1 heure
  • Langues

    Anglais, Ourdou
I'm a digital design and verification engineer with 3+ years of ASIC and FPGA experience. I mostly work in SystemVerilog, with Python and C++ for reference models and scripting. I've used Synopsys VCS, Cadence Xcelium and Vivado for simulation, and I'm comfortable with AXI4, RISC-V and lint cleanup. I can build testbenches from scratch, debug failing RTL from waveforms, write Makefile-based flows, and model behaviour in Python before RTL. I am well equipped for both verification and design related tasks.

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